Table of Contents
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IC2500
LGE7411(URSA9)
F14
A_DDR3_A[0]
A_DDR3_A0
B_DDR3_A0
B13
A_DDR3_A[1]
A_DDR3_A1
B_DDR3_A1
E13
A_DDR3_A[2]
A_DDR3_A2
B_DDR3_A2
D13
A_DDR3_A[3]
A_DDR3_A3
B_DDR3_A3
C14
A_DDR3_A[4]
A_DDR3_A4
B_DDR3_A4
F13
A_DDR3_A[5]
A_DDR3_A5
B_DDR3_A5
C13
A_DDR3_A[6]
A_DDR3_A6
B_DDR3_A6
B10
A_DDR3_A[7]
A_DDR3_A7
B_DDR3_A7
A12
A_DDR3_A[8]
A_DDR3_A8
B_DDR3_A8
C10
A_DDR3_A[9]
A_DDR3_A9
B_DDR3_A9
A14
A_DDR3_A[10]
A_DDR3_A10
B_DDR3_A10
B12
A_DDR3_A[11]
A_DDR3_A11
B_DDR3_A11
F15
A_DDR3_A[12]
A_DDR3_A12
B_DDR3_A12
C11
A_DDR3_A[13]
A_DDR3_A13
B_DDR3_A13
C12
A_DDR3_A[14]
A_DDR3_A14
B_DDR3_A14
D17
A_DDR3_A[15]
A_DDR3_A15
B_DDR3_A15
E14
A_DDR3_BA[0]
A_DDR3_BA0
B_DDR3_BA0
B14
A_DDR3_BA[1]
A_DDR3_BA1
B_DDR3_BA1
E15
A_DDR3_BA[2]
A_DDR3_BA2
B_DDR3_BA2
E17
A_DDR3_RASZ
A_DDR3_RASZ
B_DDR3_RASZ
C17
A_DDR3_CASZ
A_DDR3_CASZ
B_DDR3_CASZ
C16
A_DDR3_WEZ
B_DDR3_WEZ
A_DDR3_WEZ
F17
A_DDR3_ODT
A_DDR3_ODT
B_DDR3_ODT
C15
A_DDR3_CKE
A_DDR3_CKE
B_DDR3_CKE
B11
A_DDR3_RESET
A_DDR3_RESETB
B_DDR3_RESETB
B16
A_DDR3_MCLK
A_DDR3_MCLK
B_DDR3_MCLK
A16
A_DDR3_MCLKZ
A_DDR3_MCLKZ
B_DDR3_MCLKZ
C9
A_DDR3_CSB1
A_DDR3_CSB1
B_DDR3_CSB1
A9
A_DDR3_CSB2
A_DDR3_CSB2
B_DDR3_CSB2
A_DDR3_DQ[0-15]
A_DDR3_DQ[0]
D23
A_DDR3_DQ0
B_DDR3_DQ0
A_DDR3_DQ[1]
A19
A_DDR3_DQ1
B_DDR3_DQ1
E22
A_DDR3_DQ[2]
A_DDR3_DQ2
B_DDR3_DQ2
A_DDR3_DQ[3]
B18
A_DDR3_DQ3
B_DDR3_DQ3
A_DDR3_DQ[4]
C23
A_DDR3_DQ4
B_DDR3_DQ4
C18
A_DDR3_DQ[5]
A_DDR3_DQ5
B_DDR3_DQ5
A_DDR3_DQ[6]
B22
A_DDR3_DQ6
B_DDR3_DQ6
A_DDR3_DQ[7]
A18
A_DDR3_DQ7
B_DDR3_DQ7
E19
A_DDR3_DQ[8]
A_DDR3_DQ8
B_DDR3_DQ8
A_DDR3_DQ[9]
B21
A_DDR3_DQ9
B_DDR3_DQ9
A_DDR3_DQ[10]
F18
A_DDR3_DQ10
B_DDR3_DQ10
C22
A_DDR3_DQ[11]
A_DDR3_DQ11
B_DDR3_DQ11
A_DDR3_DQ[12]
D20
A_DDR3_DQ12
B_DDR3_DQ12
A_DDR3_DQ[13]
F22
A_DDR3_DQ13
B_DDR3_DQ13
A_DDR3_DQ[14]
E18
A_DDR3_DQ14
B_DDR3_DQ14
A_DDR3_DQ[15]
D22
A_DDR3_DQ15
B_DDR3_DQ15
B19
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A_DDR3_DM0
B_DDR3_DM0
E21
A_DDR3_DM1
A_DDR3_DM1
B_DDR3_DM1
A21
A_DDR3_DQS0
A_DDR3_DQS0
B_DDR3_DQS0
B20
A_DDR3_DQS0B
A_DDR3_DQS0B
B_DDR3_DQS0B
C20
A_DDR3_DQS1
A_DDR3_DQS1
B_DDR3_DQS1
C19
A_DDR3_DQS1B
A_DDR3_DQS1B
B_DDR3_DQS1B
A_DDR3_DQ[16-31]
A_DDR3_DQ[16]
B27
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A24
A_DDR3_DQ17
B_DDR3_DQ17
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C27
A_DDR3_DQ18
B_DDR3_DQ18
A_DDR3_DQ[19]
C24
A_DDR3_DQ19
B_DDR3_DQ19
A28
A_DDR3_DQ[20]
A_DDR3_DQ20
B_DDR3_DQ20
A_DDR3_DQ[21]
E24
A_DDR3_DQ21
B_DDR3_DQ21
A_DDR3_DQ[22]
B28
A_DDR3_DQ22
B_DDR3_DQ22
B23
A_DDR3_DQ[23]
A_DDR3_DQ23
B_DDR3_DQ23
A_DDR3_DQ[24]
D25
A_DDR3_DQ24
B_DDR3_DQ24
A_DDR3_DQ[25]
E27
A_DDR3_DQ25
B_DDR3_DQ25
C25
A_DDR3_DQ[26]
A_DDR3_DQ26
B_DDR3_DQ26
A_DDR3_DQ[27]
D28
A_DDR3_DQ27
B_DDR3_DQ27
A_DDR3_DQ[28]
E26
A_DDR3_DQ28
B_DDR3_DQ28
E28
A_DDR3_DQ[29]
A_DDR3_DQ29
B_DDR3_DQ29
A_DDR3_DQ[30]
E25
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B_DDR3_DQ30
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C28
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B_DDR3_DQ31
B24
A_DDR3_DM2
A_DDR3_DM2
B_DDR3_DM2
B26
A_DDR3_DM3
A_DDR3_DM3
B_DDR3_DM3
B25
A_DDR3_DQS2
A_DDR3_DQS2
B_DDR3_DQS2
A25
A_DDR3_DQS2B
A_DDR3_DQS2B
B_DDR3_DQS2B
D26
A_DDR3_DQS3
A_DDR3_DQS3
B_DDR3_DQS3
C26
A_DDR3_DQS3B
B_DDR3_DQS3B
A_DDR3_DQS3B
* DDR_VTT
+1.5V_U_DDR
IC13101
AP2303MPTR-G1
[EP]
VIN
NC_3
1
8
C13114
10uF
10V
GND
NC_2
2
7
DDR_VTT_URSA
R13101
10K
VREFEN
VCNTL
3
6
1/16W
1%
VOUT
NC_1
4
5
C13110
C13111
C13113
10uF
10uF
10uF
10V
10V
10V
C13118
0.1uF
16V
DDR_VTT_URSA
DDR_VTT_URSA_0
L13102
BLM18PG121SN1D
C13181
C13179
C13189
C13151
C13105
1uF
0.1uF
0.1uF
0.1uF
0.1uF
10V
16V
16V
16V
16V
DDR_VTT_URSA
DDR_VTT_URSA_1
L13103
BLM18PG121SN1D
C13112
C13132
C13158
C13174
C13106
1uF
0.1uF
0.1uF
0.1uF
0.1uF
10V
16V
16V
16V
16V
Decap removed
+1.5V_U_DDR
Close to DDR Power pin
C13104
C13109
C13117
C13128
C13137
C13146
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
16V
16V
16V
16V
16V
16V
+1.5V_U_DDR
Close to DDR Power pin
C13102
C13107
C13115
C13126
C13135
C13144
0.1uF
0.1uF
1uF
0.1uF
0.1uF
0.1uF
16V
16V
10V
16V
16V
16V
+1.5V_U_DDR
Close to DDR Power pin
Decap removed
C13103
C13108
C13116
0.1uF
0.1uF
0.1uF
16V
16V
16V
+1.5V_U_DDR
Close to DDR Power pin
Decap removed
C13195
0.1uF
16V
4th layer
Copyright ⓒ 2015 LG Electronics. Inc. All right reserved.
Only for training and service purposes
DDR PHY VREF
B_DDR3_A[0-15]
H27
B_DDR3_A[0]
G31
B_DDR3_A[1]
+1.5V_U_DDR
+1.5V_U_DDR
U_MVREFCA_A0
U_MVREFCA_A1
G28
B_DDR3_A[2]
G29
B_DDR3_A[3]
H30
B_DDR3_A[4]
R13110
R13120
G27
B_DDR3_A[5]
1K
1K
1%
G30
B_DDR3_A[6]
1%
D31
B_DDR3_A[7]
F32
B_DDR3_A[8]
R13111
C13202
C13210
R13121
C13222
D30
B_DDR3_A[9]
1K
0.1uF
1000pF
1K
0.1uF
H32
1%
B_DDR3_A[10]
1%
F31
B_DDR3_A[11]
J27
B_DDR3_A[12]
E30
B_DDR3_A[13]
F30
B_DDR3_A[14]
L29
B_DDR3_A[15]
H28
B_DDR3_BA[0]
H31
B_DDR3_BA[1]
J28
B_DDR3_BA[2]
L28
B_DDR3_RASZ
L30
B_DDR3_CASZ
K30
B_DDR3_WEZ
L27
B_DDR3_ODT
J30
B_DDR3_CKE
E31
B_DDR3_RESET
K31
B_DDR3_MCLK
+1.5V_U_DDR
K32
+1.5V_U_DDR
B_DDR3_MCLKZ
U_MVREFCA_B0
U_MVREFCA_B1
C30
B_DDR3_CSB1
C32
B_DDR3_CSB2
B_DDR3_DQ[0-15]
R13108
R13118
U29
B_DDR3_DQ[0]
1K
1K
N32
B_DDR3_DQ[1]
1%
1%
T28
B_DDR3_DQ[2]
M31
B_DDR3_DQ[3]
R13109
C13201
C13209
U30
B_DDR3_DQ[4]
R13119
C13221
1K
0.1uF
1000pF
1K
M30
0.1uF
B_DDR3_DQ[5]
1%
1%
T31
B_DDR3_DQ[6]
M32
B_DDR3_DQ[7]
N28
B_DDR3_DQ[8]
R31
B_DDR3_DQ[9]
M27
B_DDR3_DQ[10]
T30
B_DDR3_DQ[11]
P29
B_DDR3_DQ[12]
T27
B_DDR3_DQ[13]
M28
B_DDR3_DQ[14]
T29
B_DDR3_DQ[15]
N31
B_DDR3_DM0
R28
B_DDR3_DM1
R32
B_DDR3_DQS0
P31
B_DDR3_DQS0B
P30
B_DDR3_DQS1
N30
B_DDR3_DQS1B
B_DDR3_DQ[16-31]
AA31
B_DDR3_DQ[16]
V32
B_DDR3_DQ[17]
AA30
B_DDR3_DQ[18]
V30
B_DDR3_DQ[19]
AB32
B_DDR3_DQ[20]
V28
B_DDR3_DQ[21]
+1.5V_U_DDR
A_DDR3_CKE
AB31
B_DDR3_DQ[22]
U31
B_DDR3_DQ[23]
R13112
R13102
1K
1K
W29
B_DDR3_DQ[24]
AA28
B_DDR3_DQ[25]
A_DDR3_RESET
W30
B_DDR3_DQ[26]
AB29
B_DDR3_DQ[27]
Y28
B_DDR3_DQ[28]
URSA9_DDR_NANYA
IC2600-*1
AB28
B_DDR3_DQ[29]
NT5CB64M16FP-EK
W28
B_DDR3_DQ[30]
AB30
B_DDR3_DQ[31]
N3
V31
+1.5V_U_DDR
B_DDR3_CKE
A0
P7
B_DDR3_DM2
A1
P3
Y31
A2
N2
B_DDR3_DM3
R13113
A3
R13103
1K
P8
A4
1K
P2
W31
A5
B_DDR3_DQS2
R8
A6
W32
B_DDR3_RESET
R2
B_DDR3_DQS2B
A7
Y29
T8
A8
B_DDR3_DQS3
R3
A9
Y30
L7
A10/AP
B_DDR3_DQS3B
R7
N7
A11
A12/BC
T3
NC_6
M7
NC_5
M2
BA0
N8
BA1
M3
BA2
J7
CK
K7
CK
K9
CKE
+3.3V_U_NORMAL
L2
CS
K1
ODT
J3
RAS
K3
CAS
L3
C13119
WE
10uF
10V
T2
RESET
F3
DQSL
G3
DQSL
C7
B7
DQSU
DQSU
E7
DML
D3
DMU
E3
DQL0
F7
DQL1
F2
DQL2
F8
DQL3
H3
DQL4
H8
DQL5
G2
DQL6
H7
DQL7
D7
DQU0
C3
DQU1
C8
DQU2
C2
DQU3
A7
DQU4
A2
DQU5
B8
DQU6
A3
DQU7
C13156
C13164
C13172
C13178
C13186
C13194
C13198
C13206
C13214
C13218
C13226
0.1uF
0.1uF
1uF
0.1uF
0.1uF
10uF
0.1uF
0.1uF
0.1uF
0.1uF
1uF
16V
16V
10V
16V
16V
10V
16V
16V
16V
16V
10V
C13154
C13162
C13170
C13176
C13184
C13192
C13196
C13204
C13212
C13216
C13224
0.1uF
10uF
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
1uF
0.1uF
0.1uF
16V
10V
16V
16V
16V
16V
16V
16V
10V
16V
16V
C13230
1000pF
A_DDR3_A[0]
A_DDR3_A[1]
A_DDR3_A[2]
A_DDR3_A[3]
A_DDR3_A[4]
A_DDR3_A[5]
A_DDR3_A[6]
A_DDR3_A[7]
A_DDR3_A[8]
A_DDR3_A[9]
A_DDR3_A[10]
A_DDR3_A[11]
A_DDR3_A[12]
A_DDR3_A[13]
A_DDR3_A[15]
A_DDR3_MCLK
C13233
0.01uF
A_DDR3_MCLKZ
C13229
1000pF
A_DDR3_DQ[0-15]
URSA9_DDR_NANYA
URSA9_DDR_NANYA
URSA9_DDR_NANYA
IC2700-*1
IC2800-*1
IC2900-*1
NT5CB64M16FP-EK
NT5CB64M16FP-EK
NT5CB64M16FP-EK
N3
M8
N3
M8
M8
A0
VREFCA
A0
VREFCA
N3
M8
VREFCA
P7
P7
A0
VREFCA
P7
A1
A1
A1
P3
P3
P3
A2
A2
A2
H1
N2
H1
N2
H1
N2
H1
A3
VREFDQ
A3
VREFDQ
VREFDQ
P8
P8
A3
VREFDQ
A4
A4
P8
P2
P2
A4
P2
A5
A5
A5
L8
R8
L8
R8
L8
R8
L8
ZQ
A6
ZQ
A6
ZQ
A6
ZQ
R2
R2
R2
A7
A7
T8
T8
A7
A8
A8
T8
R3
B2
R3
B2
A8
B2
R3
B2
VDD_1
L7
A9
VDD_1
D9
L7
A9
VDD_1
D9
A9
VDD_1
D9
L7
D9
VDD_2
A10/AP
VDD_2
A10/AP
VDD_2
A10/AP
VDD_2
G7
R7
G7
R7
G7
R7
G7
A11
VDD_3
A11
VDD_3
VDD_3
K2
N7
K2
N7
K2
N7
A11
VDD_3
K2
A12/BC
VDD_4
A12/BC
VDD_4
VDD_4
T3
K8
T3
K8
A12/BC
VDD_4
K8
NC_6
VDD_5
NC_6
VDD_5
T3
K8
VDD_5
N1
N1
NC_6
VDD_5
N1
N1
VDD_6
VDD_6
VDD_6
VDD_6
N9
M7
N9
M7
N9
M7
N9
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VDD_7
NC_5
VDD_7
NC_5
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R1
R1
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VDD_8
VDD_8
M2
R9
M2
R9
VDD_8
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BA0
VDD_9
M2
R9
VDD_9
N8
N8
BA0
VDD_9
N8
BA1
BA1
BA1
M3
M3
M3
BA2
BA2
BA2
A1
A1
A1
A1
VDDQ_1
VDDQ_1
VDDQ_1
J7
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J7
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VDDQ_1
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CK
VDDQ_2
CK
VDDQ_2
J7
A8
VDDQ_2
K7
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K7
C1
CK
VDDQ_2
C1
K7
C1
VDDQ_3
K9
CK
VDDQ_3
C9
K9
CK
VDDQ_3
C9
CK
VDDQ_3
C9
K9
C9
VDDQ_4
CKE
VDDQ_4
CKE
VDDQ_4
CKE
VDDQ_4
D2
D2
D2
D2
VDDQ_5
VDDQ_5
VDDQ_5
E9
L2
E9
L2
E9
L2
VDDQ_5
E9
CS
VDDQ_6
CS
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F1
K1
F1
CS
VDDQ_6
F1
ODT
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ODT
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F1
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H2
J3
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ODT
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J3
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VDDQ_8
RAS
VDDQ_8
RAS
VDDQ_8
RAS
VDDQ_8
H9
K3
H9
K3
H9
K3
H9
VDDQ_9
CAS
VDDQ_9
CAS
VDDQ_9
CAS
VDDQ_9
L3
L3
L3
WE
WE
J1
J1
WE
J1
NC_1
NC_1
J1
NC_1
T2
J9
T2
J9
NC_1
J9
T2
J9
NC_2
RESET
NC_2
RESET
NC_2
RESET
NC_2
L1
L1
L1
L1
NC_3
NC_3
NC_3
NC_3
L9
L9
L9
L9
NC_4
NC_4
NC_4
F3
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F3
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G1
B8
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100
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100
100
100
100
100
100
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VSSQ_8
B_DDR3_DQ[31]
A3
G9
DQU7
VSSQ_9
THE
SYMBOL MARK OF THIS SCHEMETIC DIAGRAM INCORPORATES
SPECIAL FEATURES IMPORTANT FOR PROTECTION FROM X-RADIATION.
FIRE AND ELECTRICAL SHOCK HAZARDS, WHEN SERVICING IF IS
ESSENTIAL THAT ONLY MANUFACTURES SPECIFIED PARTS BE USED FOR
THE CRITICAL COMPONENTS IN THE
SYMBOL MARK OF THE SCHEMETIC.
M1A_URSA9_UD
2014.04.24
URSA9_DDR
131
LGE Internal Use Only
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