Motorola DSP56309 User Manual page 7

2.3 GROUND. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-6
2.4 CLOCK . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-7
2.5 PHASE-LOCKED LOOP (PLL) . . . . . . . . . . . . . . . . . . . . . . . 2-8
2.6 EXTERNAL MEMORY EXPANSION PORT (PORT A). . . . . 2-9
2.6.1 External Address Bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-9
2.6.2 External Data Bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-10
2.6.3 External Bus Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-10
2.7 INTERRUPT AND MODE CONTROL . . . . . . . . . . . . . . . . . 2-14
2.8 HOST INTERFACE (HI08) . . . . . . . . . . . . . . . . . . . . . . . . . 2-16
2.8.1 Host Port Usage Considerations. . . . . . . . . . . . . . . . . . . 2-16
2.8.2 Host Port Configuration. . . . . . . . . . . . . . . . . . . . . . . . . . 2-17
2.9 ENHANCED SYNCHRONOUS SERIAL INTERFACE . . . . 2-24
2.9.1 ESSI0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-24
2.9.2 ESSI1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-27
2.10 SERIAL COMMUNICATION INTERFACE (SCI) . . . . . . . . . 2-32
2.11 TIMERS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-33
2.12 ONCE/JTAG INTERFACE. . . . . . . . . . . . . . . . . . . . . . . . . . 2-35
SECTION 3
3.1 MEMORY SPACES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-3
3.1.1 Program Memory Space . . . . . . . . . . . . . . . . . . . . . . . . . . 3-3
3.1.2 Data Memory Spaces . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-3
3.1.2.1 X Data Memory Space . . . . . . . . . . . . . . . . . . . . . . . . . 3-4
3.1.2.2 Y Data Memory Space . . . . . . . . . . . . . . . . . . . . . . . . . 3-4
3.1.3 Memory Space Configuration . . . . . . . . . . . . . . . . . . . . . . 3-5
3.2 RAM CONFIGURATION. . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-5
3.2.1 On-Chip Program Memory (Program RAM) . . . . . . . . . . . 3-6
3.2.2 On-Chip X Data Memory (X Data RAM) . . . . . . . . . . . . . . 3-6
3.2.3 On-Chip Y Data Memory (Y Data RAM) . . . . . . . . . . . . . . 3-7
3.2.4 Bootstrap ROM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-7
3.3 MEMORY CONFIGURATIONS . . . . . . . . . . . . . . . . . . . . . . . 3-7
3.3.1 Memory Space Configurations . . . . . . . . . . . . . . . . . . . . . 3-7
3.3.2 RAM Configurations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-8
3.4 MEMORY MAPS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-9
3.5 INTERNAL I/O MEMORY MAP . . . . . . . . . . . . . . . . . . . . . . 3-18
iv
MEMORY CONFIGURATION . . . . . . . . . . . . . . . . . 3-1
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